시뮬레이션 모델을 이용한 K회사 반도체 패키지 공정의 생산량 증가를 위한 연구

• 영문명: A Study on Throughput Increase in Semiconductor Package Process of K Manufacturing Company Using a Simulation Model
• 발행기관: 한국시뮬레이션학회
• 저자명: 채종인(Jong In Chai) 박양병(Yang Byung Park)
• 간행물 정보: 『한국시뮬레이션학회 논문지』제19권 제1호, 1~11쪽, 전체 11쪽
• 주제분류: 공학 > 기타공학
• 파일형태: PDF
• 발행일자: 2010.03.30

국문 초록

K 회사는 국내외 반도체 제조업체의 주문에 의해 반도체 패키지 제품을 생산 공급하는 기업이다. 생산 공정은 Die Sawing, 조립, 테스트로 구성된 기계중심의 조립라인 형태를 따르고 있다. 본 논문은 K 회사의 공정분석을 토대로 패키지 공정의 생산량을 늘리기 위한 3가지 방안을 제안하고, 이들을 실제 자료를 이용한 시뮬레이션 모델을 통해 평가하는 사례연구를 다룬다. 3가지 방안은 병목공정에 기계 추가에 의한 라인균형, 제품의 그룹 스케쥴링, 비병목공정에서 작업자의 재배치이다. 시뮬레이션 평가결과, 3가지 방안을 혼합 적용하는 경우에 2.8%의 납기위반율 감소 효과와 함께 17.3%의 가장 높은 일일 생산량 증가를 보여 주는 것으로 나타났다. 3가지 방안의 혼합 적용하는 경우의 투자회수기간은 1.37년으로 매우 짧게 구해졌다.

영문 초록

K company produces semiconductor package products under the make-to-order policy to supply for domestic and foreign semiconductor manufacturing companies. Its production process is a machine-paced assembly line type, which consists of die sawing, assembly, and test. This paper suggests three plans to increase process throughput based on the process analysis of K company and evaluates them via a simulation model using a real data collected. The three plans are line balancing by adding machines to the bottleneck process, product group scheduling, and reallocation of the operators in non-bottleneck processes. The evaluation result shows the highest daily throughput increase of 17.3% with an effect of 2.8% reduction of due date violation when the three plans are applied together. Payback period for the mixed application of the three plans is obtained as 1.37 years.

목차

1. 서론

2. K 회사의 패키지 공정 분석

3. 패키지 공정의 생산량 증가를 위한 3가지 방안

4. 패키지 공정의 시뮬레이션 모델

5. 생산량 증가 방안의 평가

6. 결론 및 향후 과제

키워드

시뮬레이션 모델 반도체 패키지 공정 생산량 증가 라인균형 그룹 스케쥴링 사례연구 Simulation model Semiconductor package process Throughput increase Line balancing Group scheduling Case study